[Post #30/38] 위상 시프트·빈-브리지·크리스털 발진기

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📘 마이크로전자회로 연재 Post #30/38 — 13.4-13.7 (실전)

모든 디지털 시스템의 심장은 '클록(Clock)'입니다. 아무리 빠른 CPU라도 심장 박동과 같은 정확한 타이밍 신호가 없으면 동작하지 않습니다. 이번 시간에는 그 심장 박동을 만드는 발진기(Oscillator)의 핵심인 RC 위상 시프트, 빈-브리지, 그리고 정밀 주파수의 끝판왕인 크리스털 발진기까지 심층 분석합니다.

1. 개요 및 배경 ─ 왜 이 주제가 중요한가?

발진기는 에너지를 공급받아 일정한 주파수로 스스로 진동하는 회로입니다. 마치 그네를 탈 때 적절한 타이밍에 발을 구르면 더 높이 올라가는 것과 같은 '양의 귀환(Positive Feedback)' 원리를 사용합니다. 우리가 다룰 발진기들은 서로 다른 응용처를 가집니다. RC 발진기는 낮은 주파수에서 집적 회로 내부의 기준 신호를 만들 때 쓰고, 크리스털 발진기는 수 MHz에서 GHz 대역의 초정밀 타이밍이 필요한 통신 장비나 프로세서에 필수적입니다.

그림 1. 빈-브리지 발진기 회로 (Op-Amp, RC 직병렬)

2. 핵심 동작 원리

RC 위상 시프트 발진기는 3개의 RC 단을 직렬로 연결하여 신호를 180° 지연시킵니다. 증폭기 자체가 180° 반전시키므로, 전체 루프 이득은 360°(즉, 0°)가 되어 진동 조건인 '바크하우젠 기준(Barkhausen Criterion)'을 만족합니다. 빈-브리지 발진기는 좀 더 똑똑합니다. RC 직병렬 네트워크를 대역 통과 필터로 사용하여 특정 주파수에서만 위상 시프트가 0°가 되도록 설계합니다. 반면, 크리스털 발진기는 압전 효과(Piezoelectric effect)를 이용합니다. 수정 조각에 전압을 가하면 기계적으로 떨리고, 역으로 떨리면 전압이 발생하는 성질을 물리적 공진기로 활용합니다.

💡 비유로 이해하기: RC 발진기는 줄넘기를 3명이 엇박자로 돌려 타이밍을 맞추는 것이라면, 크리스털은 잘 튜닝된 튜닝 포크(소리굽쇠)를 두드려 일정한 음을 유지하는 것과 같습니다.

3. 핵심 설계 방정식

RC 위상 시프트 발진기의 발진 주파수는 다음과 같습니다.

여기서 R과 C는 각 RC 단의 소자 값이며, 증폭기 이득은 안정적인 발진을 위해 최소 29 이상 필요합니다.

빈-브리지 발진기에서의 비반전 증폭기 이득 조건은 다음과 같습니다.

이 식은 비반전 증폭기 구조에서 루프 손실을 상쇄하여 이득 1을 유지하기 위한 최소 조건입니다.

BVD(Butterworth-Van Dyke) 모델로 본 크리스털의 공진 주파수입니다.

L_s, C_s는 크리스털 내부의 기계적 탄성을 나타내는 등가 인덕턴스와 커패시턴스이며 매우 높은 Q-factor를 가집니다.

4. 구체적 수치 예제 ─ 직접 계산해 보기

주파수 10 kHz의 빈-브리지 발진기를 설계해 봅시다. C = 10 nF로 선정한다면, R은 얼마가 되어야 할까요?

공식 f = 1 / (2πRC) 에 대입하면,

이때 비반전 증폭기의 이득을 3으로 맞추기 위해 R_f = 20 kΩ, R₁ = 10 kΩ을 사용하면 전체 이득은 3이 되어 안정적인 정현파 출력이 얻어집니다. 1.59 kΩ은 표준 저항 값인 1.6 kΩ을 사용하여 오차를 보정할 수 있습니다.

그림 2. 크리스털 BVD 등가 모델과 임피던스 곡선 (직렬·병렬 공진)

5. 설계 고려사항 & 트레이드오프

• 주파수 안정성: RC 발진기는 소자 오차와 온도에 매우 민감합니다. 정밀함이 요구된다면 크리스털을 사용해야 합니다.
• Q-factor: Q가 높을수록 주파수 선택도가 높습니다. 크리스털은 Q가 10⁴~10⁶에 달해 RC 회로보다 훨씬 날카로운 스펙트럼을 제공합니다.
• 출력 왜곡: 이득이 3을 넘으면 출력이 포화되어 신호가 찌그러집니다. 따라서 실무에서는 비선형 소자(다이오드 등)를 이용한 자동 이득 제어(AGC)가 필수입니다.
• 부하 효과: 후단에 연결되는 임피던스가 발진 조건을 깨뜨릴 수 있습니다. 버퍼(Voltage Follower)를 반드시 삽입하세요.

6. 실무·연구에서 어떻게 쓰이나

크리스털 발진기는 거의 모든 MCU(예: TI C2000, STM32)의 외부 클록 소스로 사용됩니다. 또한, RF 통신 시스템의 국부 발진기(Local Oscillator) 대역을 결정하는 데 핵심 역할을 합니다. 빈-브리지 발진기는 실험실용 정밀 오디오 신호 발생기(Function Generator)의 핵심 회로로 사용됩니다.

7. 자주 겪는 함정 & 디버깅 팁

• ⚠️ 발진이 안 돼요!: 루프 이득이 1 미만일 가능성이 큽니다. 오실로스코프로 신호가 서서히 감쇠하는지 확인하세요.
• ⚠️ 파형이 사각형이 돼요!: 이득이 너무 커서 증폭기가 전원 전압 레일(Rail)에 닿아 클리핑되는 현상입니다. R_f를 줄여 이득을 낮추세요.

8. 시험·면접 빈출 포인트

• 💡 "바크하우젠 기준을 만족함에도 불구하고 발진이 시작되지 않는 이유는?" (정답: 초기 노이즈가 없거나 루프 이득이 1에 못 미칠 때)
• 💡 "크리스털 발진기에서 Pierce 회로를 쓰는 이유는?" (정답: 구현이 간단하고, 내부 부품 편차에 대해 높은 안정성을 제공하기 때문)

9. 한눈 요약

• RC 위상 시프트: 3단 RC로 180° 위상 반전, 저주파용.
• 빈-브리지: 직병렬 네트워크로 선택적 주파수 통과, 이득 3 이상 필요.
• 크리스털: 압전 효과를 이용한 초고 Q-factor 공진기.
• BVD 모델: L_s, C_s, R_s로 크리스털의 기계적 거동을 등가화.
• Pierce 회로: 크리스털 발진기 구현의 표준적 실무 회로.

본 포스트는 학습 목적이며, 실제 설계 시 데이터시트 확인과 SPICE 시뮬레이션 검증이 필요합니다.